mos管esd掩护电路,ESD掩护电路设想-KIA MOS管
信息来历：本站 日期：2024-08-20
静电掩护器件（ESD） 是由一个或多个 TVS 晶粒接纳差别的电路拓扑制成具备特定功效的多路或单路 ESD 掩护器件。ESD反向并联于电路中，当电路一般任务时，ESD处于遏制状况（高阻态），不影响电路一般任务。
当电路呈现很是过电压并到达 ESD 的击穿电压时，ESD敏捷由高阻态变为低阻态，泄放由很是过电压致使的刹时过电流到地，同时把很是过电压胁迫在一个宁静程度以内，从而掩护后级电路免遭很是过电压的破坏。
内置掩护在CMOS I/O引脚上很是罕见，这些引脚能够是器件的一局部(从简略的负载开关到中等庞杂性的微节制器，再到高庞杂性的FPGA)。它们凡是为每一个 I/O 引脚两个。一个毗连在引脚和GND之间，一个毗连在引脚和VCC之间。二者在一般任务前提下均为反向偏置(GND<=VI/O<=VCC)。
CMOS数字I/O引脚表示图，凸起显现了很多设想中遍及存在的外部掩护二极管(即便IC数据手册中不提到它们)。
它们用于在引脚发生毛病时掩护敏感的CMOS逻辑。若是VI/O 上的电压高于 VCC(比方，正 ESD 电压尖峰)，则顶部二极管导通，将引脚上的电压箝位至不跨越VCC+Vf。一样，若是VI/O上的电压降至VGND以下(比方，负ESD电压尖峰)，则底部二极管导通，将引脚上的电压箝位至不跨越?Vf。
要谨慎，因为这些二极管凡是具备相称低的最大电流。跨越此最大电流将吹动ESD二极管，凡是致使其开路，从而消弭了敏感CMOS电路的掩护，而后几近刹时被油炸。而后，您的 I/O 引脚将遏制任务。若是荣幸的话，它只会是一个受影响的引脚。若是不，全部端口(若是合用)，乃至全部装备城市被生效。
不管它们何等有效，它们也会在特定环境下发生设想挑衅，是以在停止任何触及CMOS I/O且存在ESD掩护二极管的道理图设想时，都须要细心斟酌。致使题目的两种环境是：为具备多个电压轨的电路上电时。当VI/O上的电压在某些点上能够高于VCC时，因为输出旌旗灯号的性子。在低功耗设想中，当您有挑选地关断为这些IC供电的电压轨时。
串连ESD掩护电路：这里的ESD掩护电路简略地利用一个串连电阻。对这个摹拟，利用 220R， 串连电阻用于减缓旌旗灯号的回升时辰，并且能够大大改良电路的EMC和SI。
TVS二极管：是ESD掩护电路最常用的体例之一，感化与齐纳二极管根基不异，传导速率更快，浪涌额外值更高（偶然候也不指定的持续电路/额外功率）。
有一些主要的界说/标准：
反向任务最大电压 (VRWM)：一般任务前提下应施加的最大反向电压。
击穿电压 (VBR)：二极管刚起头导通时的电压。
钳位电压 (VCLAMP)：体系在浪涌时代将履历的最大电压。
静态电阻 (RDYN)：二极管完整导通时的估量电阻。
这里要注重单向二极管和双向二极管是不一样的。 在GPIO上利用 8.2V 齐纳 (TVS) 二极管接地。
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