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MOS摹拟开关及其利用|干货分享-KIA MOS管

信息来历:本站 日期:2020-12-22 

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MOS摹拟开关及其利用|干货分享-KIA MOS管


CMOS摹拟开关及其利用

CMOS(互补金属氧化物半导体)集成电路具备微功耗、利用电源电压规模宽和抗搅扰才能强等特点。其成长日月牙异,利用规模非常普遍。上面就MOS场效应管及CMOS摹拟开关作一先容。


MOS场效应管的任务道理

金属氧化物半导体场效应三极管是经由过程光刻或分散的体例,在P型基片(衬底)上建造两个N型区,在N型区上经由过程铝层引出两个电极,即源极(S)和漏极(D)。


漏源两个分散区之间的硅表面上生成一层绝缘的氧化膜(二氧化硅),在氧化膜上也建造一个铝电极,即为栅极(G), 两个分散区和P型衬底别离构成PN结。


若是把源极和衬底相毗连,并在栅源极间加正电压UGS,就会在衬底表面构成一个导电的反型层,它把漏源两个N分散区毗连起来,成为能够或许导电的沟道,见图1 (a)


MOS摹拟开关,场效应管


若在漏源之间也加正电压UDs,则源极与漏极之间将有泄电流ID畅通,且ID随UDps的增添而增大。咱们把开始有泄电流产生时的电压叫做开启电压UT,把在P型衬底上构成的导电反型层的场效应管叫做N沟道加强型MOS场效应管。


其标记见图1(b)。 MOS场效应管的漏极特征曲线及漏极电流ID随栅极电压UGs变更的特征曲线如图2所示。


MOS摹拟开关,场效应管


CMOS摹拟开关集成电路及利用


MOS摹拟开关,场效应管


图6是一种改良了的CMOS开关电路

图7所示是一个具备四个单刀单掷开关的CMOS集成电路。


MOS摹拟开关,场效应管


此中每个开关都是由图6所示的电路构成的。图中的引出脚①、②相称于图6中的A、B两点,引出脚③相称于图6中的开关S1。


在现实利用中并不开关S1,而是加上一个幅度相称于电源(+U)的正脉冲。当未加正脉冲时,相称于S1接地(低电位)。开关处于断开状况。当正脉冲到来时,相称于S1接正电压(高电位),开关处于导通状况。咱们称图中的引出脚1和2;3和4;8和9;10和11构成四个CMOS摹拟开关。


MOS摹拟开关,场效应管


MOS摹拟开关,场效应管


它们之间的串音很小,其隔控制数字化电路。此中的IC是一个线性缩小CMOS开关,用来节制反馈电阻R1、R2、R3及R4是不是接入电路。因为节制输出端是低电位时,CMOS开关处于断开状况,故线性缩小器的反应电阻未能接上。


只在节制端为高电位时,因CMOS开关导通而接通反应电阻收集。若是在节制输出端输出差别的低电位和高电位旌旗灯号,便可使反应电阻因差别组合而获得转变。


利用CMOS开关应注重以下几点

(1) CMOS开关与其余CMOS集成电路一样,因为MOS场效应管衬底上的氧化层出格薄,故轻易被一定强度的静电荷所击穿。是以在利用时要采用一定的防静电办法,决不能在通电的环境下接插集成电路,不然电路将被破坏。


(2)经由过程开关的电流,在利用差别电源电压时有所差别。在普通环境下,工作电压为3伏到15伏,电流不跨越25亳安或15毫安,不可强行使开关经由过程更大的电流,不然会影响电路机能乃至销毁开关电路。


(3)不要把节制引出脚悬空。记着CMOS电路设想必须遵守的法则,一切的输出端必然要和相干的处所毗连好。


因为节制引出脚在集成电路的外部是与反相器相连的,若是将节制引出脚悬空,使CMOS开关处于不不变状况,反相器很可能将MOS场效应管偏置到线性任务区。这也有能够或许使电流剧增而烧环集成电路或其余有关电路。


(4)必须限定输出电压,使输出电压的变更规模不跨越电源电压的最大值或低于地。因为CMOS集成电路能够或许宁静任务的电压可到15伏,普通来讲不会呈现甚么题目。在须要的时辰能够或许先减小输出旌旗灯号,经由过程开关后再增大旌旗灯号。


CMOS摹拟开关集成电路的品种良多,用处非常普遍,只需把握了根基道理、机能,必将给咱们的任务带来极大的便利。





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